công cụ tìm kiếm bảng dữ liệu linh kiện điện tử
  Vietnamese  ▼
ALLDATASHEET.VN

X  

Preview PDF HTML

AS3517H-ECTP bảng dữ liệu(PDF) 27 Page - ams AG

tên linh kiện AS3517H-ECTP
Giải thích chi tiết về linh kiện  Stereo Audio Codec with enhanced System Power Management
PDF  94 Pages
Scroll/Zoom Zoom In 100%  Zoom Out
nhà sản xuất  AMSCO [ams AG]
Trang chủ  http://www.ams.com
Logo AMSCO - ams AG

AS3517H-ECTP bảng dữ liệu(HTML) 27 Page - ams AG

Back Button AS3517H-ECTP Datasheet HTML 23Page - ams AG AS3517H-ECTP Datasheet HTML 24Page - ams AG AS3517H-ECTP Datasheet HTML 25Page - ams AG AS3517H-ECTP Datasheet HTML 26Page - ams AG AS3517H-ECTP Datasheet HTML 27Page - ams AG AS3517H-ECTP Datasheet HTML 28Page - ams AG AS3517H-ECTP Datasheet HTML 29Page - ams AG AS3517H-ECTP Datasheet HTML 30Page - ams AG AS3517H-ECTP Datasheet HTML 31Page - ams AG Next Button
Zoom Inzoom in Zoom Outzoom out
 27 / 94 page
background image
AS3517 V17
Data Sheet, Confidential
© 2003-2007, austriamicrosystems AG, 8141 Unterpremstaetten, Austria-Europe. All Rights Reserved.
www.austriamicrosystems.com
Figure 11 I2S Timing
Table 22 Audio Converter Parameter
Symbol
Parameter
Min
Typ
Max
Unit
Note
tSCLK
SCLK Cycle Time
160
ns
tSCLKH
SCLK Pulse Width High
80
ns
tSCLKL
SCLK Pulse Width Low
80
ns
TLRSU
LRCLK Setup Time before
SCLK rising edge
80
ns
TLRHD
LRCLK Hold Time after SCLK
rising edge
80
ns
tSDSU
SDI setup time before SCLK
rising edge
25
ns
tSDHD
SDI hold time after SCLK
rising edge
25
ns
tSDOD
SDO Delay from SCLK falling
edge
25
ns
tJITTER
Jitter of LRCLK
-20
20
ns
internal PLL generates
MCLK from LRCLK
I2S Direct mode
TSCD
SCLK delay after MCLK
rising edge
0.5
1.5
ns
TLRD
LRLCK delay after SCLK
rising edge
0.5
1.5
ns
tSDSU
SDI setup time before SCLK
rising edge
5
ns
tSDHD
SDI hold time after SCLK
rising edge
5
ns
tSDOD
SDO Delay from SCLK falling
edge
15
ns
VI2SH
SCLK, LRCLK, SDI, MCLK
High Input Level
1.02
V
DVDD/2*0.7
VI2SL
SCLK, LRCLK, SDI, MCLK
Low Input Level
0.42
V
DVDD/2*0.3
VSDOH
SDO High Output Level
2.6
V
at 2mA
VSDOL
SDO Low Output Level
0.3
V
at 2mA
VI2SOH
SCLK, LRCLK, High Output
Level
2.6
V
at 8mA master mode only
VI2SOL
SCLK, LRCLK, Low Output
Level
0.3
V
at 8mA master mode only
BVDD=3.3V, TA=25°C, Slave Mode, fS=48kHz, MCLK = 256*fS, unless otherwise specified
Revision 1v3
26
- 93



Html Pages

1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32 33 34 35 36 37 38 39 40 41 42 43 44 45 46 47 48 49 50 51 52 53 54 55 56 57 58 59 60 61 62 63 64 65 66 67 68 69 70 71 72 73 74 75 76 77 78 79 80 81 82 83 84 85 86 87 88 89 90 91 92 93 94


bảng dữ liệu tải về

Go To PDF Page


Link URL



Cho đến nay ALLDATASHEET có giúp ích cho doanh nghiệp của bạn hay không?  [ DONATE ] 

Alldatasheet là   |   Quảng cáo   |   Liên lạc với chúng tôi   |   Chính sách bảo mật   |   Liên kết đến bảng dữ liệu    |   Trao đổi link   |   Tìm kiếm theo nhà sản xuất
All Rights Reserved©Alldatasheet.com


Mirror Sites
English : Alldatasheet.com  |   English : Alldatasheet.net  |   Chinese : Alldatasheetcn.com  |   German : Alldatasheetde.com  |   Japanese : Alldatasheet.jp
Russian : Alldatasheetru.com  |   Korean : Alldatasheet.co.kr  |   Spanish : Alldatasheet.es  |   French : Alldatasheet.fr  |   Italian : Alldatasheetit.com
Portuguese : Alldatasheetpt.com  |   Polish : Alldatasheet.pl  |   Vietnamese : Alldatasheet.vn
Indian : Alldatasheet.in  |   Mexican : Alldatasheet.com.mx  |   British : Alldatasheet.co.uk  |   New Zealand : Alldatasheet.co.nz
Family Site : ic2ic.com  |   icmetro.com