công cụ tìm kiếm bảng dữ liệu linh kiện điện tử
  Vietnamese  ▼
ALLDATASHEET.VN

X  

Preview PDF HTML

CS53L30 bảng dữ liệu(PDF) 31 Page - Cirrus Logic

tên linh kiện CS53L30
Giải thích chi tiết về linh kiện  Low-Power Quad-Channel Microphone ADC with TDM Output
PDF  67 Pages
Scroll/Zoom Zoom In 100%  Zoom Out
nhà sản xuất  CIRRUS [Cirrus Logic]
Trang chủ  http://www.cirrus.com
Logo CIRRUS - Cirrus Logic

CS53L30 bảng dữ liệu(HTML) 31 Page - Cirrus Logic

Back Button CS53L30 Datasheet HTML 27Page - Cirrus Logic CS53L30 Datasheet HTML 28Page - Cirrus Logic CS53L30 Datasheet HTML 29Page - Cirrus Logic CS53L30 Datasheet HTML 30Page - Cirrus Logic CS53L30 Datasheet HTML 31Page - Cirrus Logic CS53L30 Datasheet HTML 32Page - Cirrus Logic CS53L30 Datasheet HTML 33Page - Cirrus Logic CS53L30 Datasheet HTML 34Page - Cirrus Logic CS53L30 Datasheet HTML 35Page - Cirrus Logic Next Button
Zoom Inzoom in Zoom Outzoom out
 31 / 67 page
background image
DS992F2
31
CS53L30
4.7 TDM Mode
4.7.2
Bursted SCLK
After all the data is sent on the TDM bus, it is not necessary to continue to toggle SCLK for the remaining unused slots.
Not toggling SCLK after all data is sent and received saves power, by avoiding driving the output and clock capacitances
unnecessarily. When the device is operating as a timing slave, bursted SCLK is naturally supported, since data is clocked
out only when SCLK toggles. When the device is operating as a timing master, bursted SCLK is not supported.
6.0000
8.000
48
366
11.025
48
160
12.000
48
116
16.000
46
7
22.050
34
0
24.000
31
2
32.000
23
4
44.100
17
0
48.000
15
5
12.0000
8.000
48
1116
11.025
48
704
12.000
48
616
16.000
48
366
22.050
48
160
24.000
48
116
32.000
46
8
44.100
34
0
48.000
31
2
6.1440
8.000
48
384
11.025
48
173
12.000
48
128
16.000
48
0
22.050
34
6
24.000
32
0
32.000
24
0
44.100
17
3
48.000
16
0
12.2880
8.000
48
1152
11.025
48
731
12.000
48
640
16.000
48
384
22.050
48
173
24.000
48
128
32.000
48
0
44.100
34
6
48.000
32
0
6.4000 1
8.000
48
416
11.025
48
196
12.000
48
149
16.000
48
16
22.050
36
2
24.000
33
2
32.000
25
0
44.100
18
1
48.000
16
5
1. 6.4 MHz is the highest SCLK frequency allowed if MCLK_19MHZ_EN is set.
Table 4-3. Slot Count and Resulting Unused Clock Cycles for Supported SCLK and Sample Rates (Cont.)
SCLK Frequency [MHz] FSYNC Sample Rate [kHz] Number of Available Slots Resulting Number of Unused SCLK Cycles



Html Pages

1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32 33 34 35 36 37 38 39 40 41 42 43 44 45 46 47 48 49 50 51 52 53 54 55 56 57 58 59 60 61 62 63 64 65 66 67


bảng dữ liệu tải về

Go To PDF Page


Link URL



Cho đến nay ALLDATASHEET có giúp ích cho doanh nghiệp của bạn hay không?  [ DONATE ] 

Alldatasheet là   |   Quảng cáo   |   Liên lạc với chúng tôi   |   Chính sách bảo mật   |   Liên kết đến bảng dữ liệu    |   Trao đổi link   |   Tìm kiếm theo nhà sản xuất
All Rights Reserved©Alldatasheet.com


Mirror Sites
English : Alldatasheet.com  |   English : Alldatasheet.net  |   Chinese : Alldatasheetcn.com  |   German : Alldatasheetde.com  |   Japanese : Alldatasheet.jp
Russian : Alldatasheetru.com  |   Korean : Alldatasheet.co.kr  |   Spanish : Alldatasheet.es  |   French : Alldatasheet.fr  |   Italian : Alldatasheetit.com
Portuguese : Alldatasheetpt.com  |   Polish : Alldatasheet.pl  |   Vietnamese : Alldatasheet.vn
Indian : Alldatasheet.in  |   Mexican : Alldatasheet.com.mx  |   British : Alldatasheet.co.uk  |   New Zealand : Alldatasheet.co.nz
Family Site : ic2ic.com  |   icmetro.com