công cụ tìm kiếm bảng dữ liệu linh kiện điện tử
  Vietnamese  ▼
ALLDATASHEET.VN

X  

Preview PDF HTML

PSD835G2-70UI bảng dữ liệu(PDF) 89 Page - STMicroelectronics

tên linh kiện PSD835G2-70UI
Giải thích chi tiết về linh kiện  Configurable Memory System on a Chip for 8-Bit Microcontrollers
PDF  110 Pages
Scroll/Zoom Zoom In 100%  Zoom Out
nhà sản xuất  STMICROELECTRONICS [STMicroelectronics]
Trang chủ  http://www.st.com
Logo STMICROELECTRONICS - STMicroelectronics

PSD835G2-70UI bảng dữ liệu(HTML) 89 Page - STMicroelectronics

Back Button PSD835G2-70UI Datasheet HTML 85Page - STMicroelectronics PSD835G2-70UI Datasheet HTML 86Page - STMicroelectronics PSD835G2-70UI Datasheet HTML 87Page - STMicroelectronics PSD835G2-70UI Datasheet HTML 88Page - STMicroelectronics PSD835G2-70UI Datasheet HTML 89Page - STMicroelectronics PSD835G2-70UI Datasheet HTML 90Page - STMicroelectronics PSD835G2-70UI Datasheet HTML 91Page - STMicroelectronics PSD835G2-70UI Datasheet HTML 92Page - STMicroelectronics PSD835G2-70UI Datasheet HTML 93Page - STMicroelectronics Next Button
Zoom Inzoom in Zoom Outzoom out
 89 / 110 page
background image
PSD8XX Family
PSD835G2
88
-90
-12
PT
TURBO
Slew
Symbol
Parameter
Conditions
Min
Max
Min
Max
Aloc
OFF
Rate
Unit
Maximum Frequency
External Feedback
1/(tSA+t COA)
23.8
20.8
MHz
Maximum Frequency
fMAXA
Internal Feedback ( fCNTA)
1/(tSA+t COA–10)
31.25
26.3
MHz
Maximum Frequency
Pipelined Data
1/(tCH A+t CLA)
38.4
30.3
MHz
tSA
Input Setup Time
8
10
Add 4 Add 20
ns
tHA
Input Hold Time
10
12
ns
tCHA
Clock High Time
15
18
Add 20
ns
tCLA
Clock Low Time
12
15
Add 20
ns
tCOA
Clock to Output Delay
34
38
Add 20 Sub 6
ns
tARD
GPLD Array Delay
Any Micro
⇔Cell
23
27
Add 4
ns
tMINA
Minimum Clock Period
1/ fCNTA
32
38
ns
GPLD Micro
⇔Cell Asynchronous Clock Mode Timing (3.0 V to 3.6 V Versions)
NOTE: 1. Inputs from Port A, B, and C relative to register/latch clock from the PLD. ALE latch timings refer to tAVLX and tLXAX.
-90
-12
PT
TURBO
Symbol
Parameter
Conditions
Min
Max
Min
Max
Aloc
OFF
Unit
tIS
Input Setup Time
(Note 1)
0
0
ns
tIH
Input Hold Time
(Note 1)
20
23
Add 20
ns
tINH
NIB Input High Time
(Note 1)
13
13
ns
tINL
NIB Input Low Time
(Note 1)
12
13
ns
tINO
NIB Input to Combinatorial
Delay
(Note 1)
46
62
Add 4
Add 20
ns
Input Micro
⇔Cell Timing (3.0 V to 3.6 V Versions)
PSD835G2 AC/DC Parameters – GPLD Timing Parameters
(3.0 V to 3.6 V Versions)



Html Pages

1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32 33 34 35 36 37 38 39 40 41 42 43 44 45 46 47 48 49 50 51 52 53 54 55 56 57 58 59 60 61 62 63 64 65 66 67 68 69 70 71 72 73 74 75 76 77 78 79 80 81 82 83 84 85 86 87 88 89 90 91 92 93 94 95 96 97 98 99 100  ...More


bảng dữ liệu tải về

Go To PDF Page


Link URL



Cho đến nay ALLDATASHEET có giúp ích cho doanh nghiệp của bạn hay không?  [ DONATE ] 

Alldatasheet là   |   Quảng cáo   |   Liên lạc với chúng tôi   |   Chính sách bảo mật   |   Liên kết đến bảng dữ liệu    |   Trao đổi link   |   Tìm kiếm theo nhà sản xuất
All Rights Reserved©Alldatasheet.com


Mirror Sites
English : Alldatasheet.com  |   English : Alldatasheet.net  |   Chinese : Alldatasheetcn.com  |   German : Alldatasheetde.com  |   Japanese : Alldatasheet.jp
Russian : Alldatasheetru.com  |   Korean : Alldatasheet.co.kr  |   Spanish : Alldatasheet.es  |   French : Alldatasheet.fr  |   Italian : Alldatasheetit.com
Portuguese : Alldatasheetpt.com  |   Polish : Alldatasheet.pl  |   Vietnamese : Alldatasheet.vn
Indian : Alldatasheet.in  |   Mexican : Alldatasheet.com.mx  |   British : Alldatasheet.co.uk  |   New Zealand : Alldatasheet.co.nz
Family Site : ic2ic.com  |   icmetro.com