| công cụ tìm kiếm bảng dữ liệu linh kiện điện tử |
|
PCIMX258CJM4A bảng dữ liệu(PDF) 60 Page - Freescale Semiconductor, Inc |
|
|
|||||||||||||||||||||||||||||
PCIMX258CJM4A bảng dữ liệu(HTML) 60 Page - Freescale Semiconductor, Inc |
|
60 / 144 page ![]() i.MX25 Applications Processor for Consumer and Industrial Products, Rev. 3 60 Freescale Semiconductor Figure 28. SDRAM Self-Refresh Cycle Timing Diagram NOTE The clock continues to run unless CKE is low. Then the clock is stopped in low state. Table 44. SDRAM Refresh Timing Parameters ID Parameter Symbol Min. Max. Unit SD1 SDRAM clock high-level width tCH 3.4 4.1 ns SD2 SDRAM clock low-level width tCL 3.4 4.1 ns SD3 SDRAM clock cycle time tCK 7.5 — ns SD6 Address setup time tAS 1.8 — ns SD7 Address hold time tAH 1.8 — ns SD10 Precharge cycle period1 1 SD10 and SD11 are determined by SDRAM controller register settings. tRP 1 4 clock SD11 Auto precharge command period1 tRC 2 20 clock SDCLK CS CAS RAS ADDR BA WE CKE Don’t care SD16 SD16 |
|
Link URL |
| Cho đến nay ALLDATASHEET có giúp ích cho doanh nghiệp của bạn hay không? [ DONATE ] |
Alldatasheet là | Quảng cáo | Liên lạc với chúng tôi | Chính sách bảo mật | Liên kết đến bảng dữ liệu | Trao đổi link | Tìm kiếm theo nhà sản xuất All Rights Reserved©Alldatasheet.com |
| Russian : Alldatasheetru.com | Korean : Alldatasheet.co.kr | Spanish : Alldatasheet.es | French : Alldatasheet.fr | Italian : Alldatasheetit.com Portuguese : Alldatasheetpt.com | Polish : Alldatasheet.pl | Vietnamese : Alldatasheet.vn Indian : Alldatasheet.in | Mexican : Alldatasheet.com.mx | British : Alldatasheet.co.uk | New Zealand : Alldatasheet.co.nz |
|
Family Site : ic2ic.com |
icmetro.com |