| công cụ tìm kiếm bảng dữ liệu linh kiện điện tử |
|
NUC505-YO2G bảng dữ liệu(PDF) 121 Page - Nuvoton Technology Corporation |
|
|
|||||||||||||||||||||||||||||
NUC505-YO2G bảng dữ liệu(HTML) 121 Page - Nuvoton Technology Corporation |
|
121 / 130 page ![]() NUC505 July. 26, 2018 Page 121 of 130 Rev.1.08 7.4.9 I 2S Dynamic Characteristics Symbol Parameter Min. Max. Unit Test Conditions th(WS) I2S clock high time 42 - ns Master fPCLK = 12.288 MHz, data: 24 bits, audio frequency = 48 kHz tsu(WS) I2S clock low time 37 - th(WS) LRCLK valid time 7 - Master mode DuCy(SCK) LRCLK hold time 1 - Master mode tsu(SD_MR) LRCLK setup time 34 - Slave mode tsu(SD_SR) LRCLK hold time 0 - Slave mode th(SD_MR) I2S slave input clock duty cycle 25 75 % Slave mode th(SD_SR) Data input setup time 0 - ns Master receiver tv(SD_ST) 0 - Slave receiver th(SD_ST) Data input hold time 0 - Master receiver tv(SD_MT) 0 - Slave receiver th(SD_MT) Data output valid time - 32 Slave transmitter (after enable edge) th(WS) Data output hold time 16 - Slave transmitter (after enable edge) tsu(WS) Data output valid time - 5 Master transmitter (after enable edge) th(WS) Data output hold time 0 - Master transmitter (after enable edge) |
|
Link URL |
| Cho đến nay ALLDATASHEET có giúp ích cho doanh nghiệp của bạn hay không? [ DONATE ] |
Alldatasheet là | Quảng cáo | Liên lạc với chúng tôi | Chính sách bảo mật | Liên kết đến bảng dữ liệu | Trao đổi link | Tìm kiếm theo nhà sản xuất All Rights Reserved©Alldatasheet.com |
| Russian : Alldatasheetru.com | Korean : Alldatasheet.co.kr | Spanish : Alldatasheet.es | French : Alldatasheet.fr | Italian : Alldatasheetit.com Portuguese : Alldatasheetpt.com | Polish : Alldatasheet.pl | Vietnamese : Alldatasheet.vn Indian : Alldatasheet.in | Mexican : Alldatasheet.com.mx | British : Alldatasheet.co.uk | New Zealand : Alldatasheet.co.nz |
|
Family Site : ic2ic.com |
icmetro.com |