| công cụ tìm kiếm bảng dữ liệu linh kiện điện tử |
|
SH7721 bảng dữ liệu(PDF) 280 Page - Renesas Technology Corp |
|
|
|||||||||||||||||||||||||||||
SH7721 bảng dữ liệu(HTML) 280 Page - Renesas Technology Corp |
|
280 / 1524 page ![]() Section 7 Exception Handling Rev. 3.00 Jan. 18, 2008 Page 218 of 1458 REJ09B0033-0300 Figure 7.1 shows the bit configuration of each register. 31 TRA EXPEVT INTEVT2 TRA EXPEVT INTEVT2 TEA TEA 10 9 2 1 0 31 12 11 0 0 0 0 0 31 12 11 0 INTEVT INTEVT 0 31 12 11 0 31 0 Figure 7.1 Register Bit Configuration 7.1.1 TRAPA Exception Register (TRA) TRA is assigned to address H'FFFFFFD0 and consists of the 8-bit immediate data (imm) of the TRAPA instruction. TRA is automatically specified by the hardware when the TRAPA instruction is executed. Only bits 9 to 2 of the TRA can be re-written using the software. Bit Bit Name Initial Value R/W Description 31 to 10 R Reserved These bits are always read as 0. The write value should always be 0. 9 to 2 TRA R/W 8-bit Immediate Data 1, 0 R Reserved These bits are always read as 0. The write value should always be 0. |
|
Link URL |
| Cho đến nay ALLDATASHEET có giúp ích cho doanh nghiệp của bạn hay không? [ DONATE ] |
Alldatasheet là | Quảng cáo | Liên lạc với chúng tôi | Chính sách bảo mật | Liên kết đến bảng dữ liệu | Trao đổi link | Tìm kiếm theo nhà sản xuất All Rights Reserved©Alldatasheet.com |
| Russian : Alldatasheetru.com | Korean : Alldatasheet.co.kr | Spanish : Alldatasheet.es | French : Alldatasheet.fr | Italian : Alldatasheetit.com Portuguese : Alldatasheetpt.com | Polish : Alldatasheet.pl | Vietnamese : Alldatasheet.vn Indian : Alldatasheet.in | Mexican : Alldatasheet.com.mx | British : Alldatasheet.co.uk | New Zealand : Alldatasheet.co.nz |
|
Family Site : ic2ic.com |
icmetro.com |