 |
công cụ tìm kiếm bảng dữ liệu linh kiện điện tử |
|
|
công cụ tìm kiếm bảng dữ liệu linh kiện điện tử |
|
ADV7330KST bảng dữ liệu(PDF) 65 Page - Analog Devices |
|
|
|||||||||||||||||||||||||||||
ADV7330KST bảng dữ liệu(HTML) 65 Page - Analog Devices |
|
|
65 / 76 page  REV. B ADV7330 –65– Mode 2—Master Option (Timing Register 0 TR0 = X X X X X 1 0 1) In this mode, the ADV7330 can generate horizontal and vertical sync signals. A coincident low transition of both HSYNC_O/P and VSYNC_O/P outputs indicates the start of an odd field. A VSYNC_O/P low transition when HSYNC_O/P is high indicates the start of an even field. HSYNC is output on the HSYNC_O/P pin, BLANK on the BLANK_O/P pin, and VSYNC on the VSYNC_O/P pin. PAL = 12 CLOCK/2 NTSC = 16 CLOCK/2 PAL = 132 CLOCK/2 NTSC = 122 CLOCK/2 Cb Y Cr Y PIXEL DATA HSYNC_O/P BLANK_O/P VSYNC_O/P Figure 78. SD Timing Mode 2—Even to Odd Field Transition Master/Slave PAL = 864 CLOCK/2 NTSC = 858 CLOCK/2 PAL = 132 CLOCK/2 NTSC = 122 CLOCK/2 PIXEL DATA PAL = 12 CLOCK/2 NTSC = 16 CLOCK/2 Cb Y Cr Y Cb HSYNC_O/P BLANK_O/P VSYNC_O/P Figure 79. SD Timing Mode 2—Odd to Even Field Transition Master/Slave |
|
Link URL |
| Cho đến nay ALLDATASHEET có giúp ích cho doanh nghiệp của bạn hay không? [ DONATE ] |
Alldatasheet là | Quảng cáo | Liên lạc với chúng tôi | Chính sách bảo mật | Liên kết đến bảng dữ liệu | Trao đổi link | Tìm kiếm theo nhà sản xuất All Rights Reserved©Alldatasheet.com |
| Russian : Alldatasheetru.com | Korean : Alldatasheet.co.kr | Spanish : Alldatasheet.es | French : Alldatasheet.fr | Italian : Alldatasheetit.com Portuguese : Alldatasheetpt.com | Polish : Alldatasheet.pl | Vietnamese : Alldatasheet.vn Indian : Alldatasheet.in | Mexican : Alldatasheet.com.mx | British : Alldatasheet.co.uk | New Zealand : Alldatasheet.co.nz |
|
Family Site : ic2ic.com |
icmetro.com |
Vietnamese ▼
English
Chinese
German
Japanese
Russian
Korean
Spanish
French
Italian
Portuguese
Polish
Vietnamese
Indian
Mexican
British
New Zealand
