công cụ tìm kiếm bảng dữ liệu linh kiện điện tử
  Vietnamese  ▼
ALLDATASHEET.VN

X  

Preview PDF HTML

AX2000 bảng dữ liệu(PDF) 106 Page - Microsemi Corporation

tên linh kiện AX2000
Giải thích chi tiết về linh kiện  Axcelerator Family FPGAs
PDF  262 Pages
Scroll/Zoom Zoom In 100%  Zoom Out
nhà sản xuất  MICROSEMI [Microsemi Corporation]
Trang chủ  http://www.microsemi.com
Logo MICROSEMI - Microsemi Corporation

AX2000 bảng dữ liệu(HTML) 106 Page - Microsemi Corporation

Back Button AX2000 Datasheet HTML 102Page - Microsemi Corporation AX2000 Datasheet HTML 103Page - Microsemi Corporation AX2000 Datasheet HTML 104Page - Microsemi Corporation AX2000 Datasheet HTML 105Page - Microsemi Corporation AX2000 Datasheet HTML 106Page - Microsemi Corporation AX2000 Datasheet HTML 107Page - Microsemi Corporation AX2000 Datasheet HTML 108Page - Microsemi Corporation AX2000 Datasheet HTML 109Page - Microsemi Corporation AX2000 Datasheet HTML 110Page - Microsemi Corporation Next Button
Zoom Inzoom in Zoom Outzoom out
 106 / 262 page
background image
Detailed Specifications
2- 92
R e v i sio n 1 8
Table 2-91 • Four RAM Blocks Cascaded
Worst-Case Commercial Conditions VCCA = 1.425 V, VCCI = 3.0 V, TJ = 70°C
–2 Speed
–1 Speed
Std Speed
Parameter
Description
Min.
Max.
Min.
Max.
Min.
Max.
Units
Write Mode
tWDASU
Write Data Setup vs. WCLK
2.37
2.70
3.17
ns
tWDAHD
Write Data Hold vs. WCLK
0.00
0.00
0.00
ns
tWADSU
Write Address Setup vs. WCLK
2.37
2.70
3.17
ns
tWADHD
Write Address Hold vs. WCLK
0.00
0.00
0.00
ns
tWENSU
Write Enable Setup vs. WCLK
2.37
2.70
3.17
ns
tWENHD
Write Enable Hold vs. WCLK
0.00
0.00
0.00
ns
tWCKH
WCLK Minimum High Pulse Width
0.75
0.75
0.75
ns
tWCLK
WCLK Minimum Low Pulse Width
2.51
2.51
2.51
ns
tWCKP
WCLK Minimum Period
3.26
3.26
3.26
ns
Read Mode
tRADSU
Read Address Setup vs. RCLK
3.08
3.51
4.13
ns
tRADHD
Read Address Hold vs. RCLK
0.00
0.00
0.00
ns
tRENSU
Read Enable Setup vs. RCLK
3.08
3.51
4.13
ns
tRENHD
Read Enable Hold vs. RCLK
0.00
0.00
0.00
ns
tRCK2RD1
RCLK-To-OUT (Pipelined)
2.36
2.69
3.16
ns
tRCK2RD2
RCLK-To-OUT (Non-Pipelined)
2.83
3.23
3.79
ns
tRCLKH
RCLK Minimum High Pulse Width
0.73
0.73
0.73
ns
tRCLKL
RCLK Minimum Low Pulse Width
2.96
2.96
2.96
ns
tRCKP
RCLK Minimum Period
3.69
3.69
3.69
ns
Note:
Timing data for these four cascaded RAM blocks uses a depth of 16,384. For all other combinations, use
Microsemi’s timing software.



Html Pages

1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32 33 34 35 36 37 38 39 40 41 42 43 44 45 46 47 48 49 50 51 52 53 54 55 56 57 58 59 60 61 62 63 64 65 66 67 68 69 70 71 72 73 74 75 76 77 78 79 80 81 82 83 84 85 86 87 88 89 90 91 92 93 94 95 96 97 98 99 100  ...More


bảng dữ liệu tải về

Go To PDF Page


Link URL



Cho đến nay ALLDATASHEET có giúp ích cho doanh nghiệp của bạn hay không?  [ DONATE ] 

Alldatasheet là   |   Quảng cáo   |   Liên lạc với chúng tôi   |   Chính sách bảo mật   |   Liên kết đến bảng dữ liệu    |   Trao đổi link   |   Tìm kiếm theo nhà sản xuất
All Rights Reserved©Alldatasheet.com


Mirror Sites
English : Alldatasheet.com  |   English : Alldatasheet.net  |   Chinese : Alldatasheetcn.com  |   German : Alldatasheetde.com  |   Japanese : Alldatasheet.jp
Russian : Alldatasheetru.com  |   Korean : Alldatasheet.co.kr  |   Spanish : Alldatasheet.es  |   French : Alldatasheet.fr  |   Italian : Alldatasheetit.com
Portuguese : Alldatasheetpt.com  |   Polish : Alldatasheet.pl  |   Vietnamese : Alldatasheet.vn
Indian : Alldatasheet.in  |   Mexican : Alldatasheet.com.mx  |   British : Alldatasheet.co.uk  |   New Zealand : Alldatasheet.co.nz
Family Site : ic2ic.com  |   icmetro.com