| công cụ tìm kiếm bảng dữ liệu linh kiện điện tử |
|
CS8415A-CSZ bảng dữ liệu(PDF) 45 Page - Cirrus Logic |
|
|
|||||||||||||||||||||||||||||
CS8415A-CSZ bảng dữ liệu(HTML) 45 Page - Cirrus Logic |
|
45 / 46 page ![]() DS470F4 45 CS8415A 15.3.4 Jitter Attenuation Shown in Figure 21, Figure 22, Figure 23, and Figure 24 are jitter attenuation plots for the various revi- sions of the CS8415A when used with the appropriate external PLL component values (as noted in Table 6). The AES3 and IEC60958-4 specifications do not have allowances for locking to sample rates less than 32 kHz. These specifications state a maximum of 2 dB jitter gain or peaking. 10 −1 10 0 10 1 10 2 10 3 10 4 10 5 −20 −15 −10 −5 0 5 Jitter Frequency (Hz) 10 −1 10 0 10 1 10 2 10 3 10 4 10 5 −20 −15 −10 −5 0 5 Jitter Frequency (Hz) 10 −1 10 0 10 1 10 2 10 3 10 4 10 5 −25 −20 −15 −10 −5 0 5 Jitter Frequency (Hz) 10 −1 10 0 10 1 10 2 10 3 10 4 10 5 −25 −20 −15 −10 −5 0 5 Jitter Frequency (Hz) Figure 21. Revision A Figure 22. Revision A1 Figure 23. Revision A2 using A1 Values Figure 24. Revision A2 using A2* Values |
|
Link URL |
| Cho đến nay ALLDATASHEET có giúp ích cho doanh nghiệp của bạn hay không? [ DONATE ] |
Alldatasheet là | Quảng cáo | Liên lạc với chúng tôi | Chính sách bảo mật | Liên kết đến bảng dữ liệu | Trao đổi link | Tìm kiếm theo nhà sản xuất All Rights Reserved©Alldatasheet.com |
| Russian : Alldatasheetru.com | Korean : Alldatasheet.co.kr | Spanish : Alldatasheet.es | French : Alldatasheet.fr | Italian : Alldatasheetit.com Portuguese : Alldatasheetpt.com | Polish : Alldatasheet.pl | Vietnamese : Alldatasheet.vn Indian : Alldatasheet.in | Mexican : Alldatasheet.com.mx | British : Alldatasheet.co.uk | New Zealand : Alldatasheet.co.nz |
|
Family Site : ic2ic.com |
icmetro.com |