công cụ tìm kiếm bảng dữ liệu linh kiện điện tử
  Vietnamese  ▼
ALLDATASHEET.VN

X  

AD7985BCPZ bảng dữ liệu(PDF) 6 Page - Analog Devices

tên linh kiện AD7985BCPZ
Giải thích chi tiết về linh kiện  16-Bit, 2.5 MSPS, PulSAR 15.5 mW ADC in LFCSP
PDF  29 Pages
Scroll/Zoom Zoom In 100%  Zoom Out
nhà sản xuất  AD [Analog Devices]
Trang chủ  http://www.analog.com
Logo AD - Analog Devices

AD7985BCPZ bảng dữ liệu(HTML) 6 Page - Analog Devices

Back Button AD7985BCPZ Datasheet HTML 2Page - Analog Devices AD7985BCPZ Datasheet HTML 3Page - Analog Devices AD7985BCPZ Datasheet HTML 4Page - Analog Devices AD7985BCPZ Datasheet HTML 5Page - Analog Devices AD7985BCPZ Datasheet HTML 6Page - Analog Devices AD7985BCPZ Datasheet HTML 7Page - Analog Devices AD7985BCPZ Datasheet HTML 8Page - Analog Devices AD7985BCPZ Datasheet HTML 9Page - Analog Devices AD7985BCPZ Datasheet HTML 10Page - Analog Devices Next Button
Zoom Inzoom in Zoom Outzoom out
 6 / 29 page
background image
Data Sheet
AD7985
Rev. C | Page 5 of 28
TIMING SPECIFICATIONS
AVDD = DVDD = 2.5 V, BVDD = 5 V, VIO = 1.8 V to 2.7 V, VREF = 4.096 V, TA = −40°C to +85°C, unless otherwise noted.1
Table 4.
Parameter
Symbol
Test Conditions/Comments
Min
Typ
Max
Unit
Conversion Time: CNV Rising Edge
to Data Available
tCONV
Turbo mode/normal mode
320/420
ns
Acquisition Time
tACQ
80
ns
Time Between Conversions
tCYC
Turbo mode/normal mode
400/500
ns
CNV Pulse Width
tCNVH
CS mode
10
ns
Data Read During Conversion
tDATA
Turbo mode/normal mode
190/290
ns
Quiet Time During Acquisition from Last SCK
Falling Edge to CNV Rising Edge
tQUIET
20
ns
SCK Period
tSCK
CS mode
9
ns
tSCK
Chain mode
11
ns
SCK Low Time
tSCKL
3.5
ns
SCK High Time
tSCKH
3.5
ns
SCK Falling Edge to Data Remains Valid
tHSDO
2
ns
SCK Falling Edge to Data Valid Delay
tDSDO
4
ns
CNV or SDI Low to SDO D15 MSB Valid
tEN
5
ns
CNV or SDI High or Last SCK Falling Edge
to SDO High Impedance
tDIS
CS mode
8
ns
SDI Valid Setup Time from CNV Rising Edge
tSSDICNV
4
ns
SDI Valid Hold Time from CNV Rising Edge
tHSDICNV
CS mode
0
ns
tHSDICNV
Chain mode
0
ns
SCK Valid Setup Time from CNV Rising Edge
tSSCKCNV
Chain mode
5
ns
SCK Valid Hold Time from CNV Rising Edge
tHSCKCNV
Chain mode
5
ns
SDI Valid Setup Time from SCK Falling Edge
tSSDISCK
Chain mode
2
ns
SDI Valid Hold Time from SCK Falling Edge
tHSDISCK
Chain mode
3
ns
SDI High to SDO High
tDSDOSDI
Chain mode with busy indicator
15
ns
1
See Figure 2 and Figure 3 for load conditions.
500µA
IOL
500µA
IOH
1.4V
TO SDO
CL
20pF
Figure 2. Load Circuit for Digital Interface Timing
90% VIO
10% VIO
VIH1
VIL1
VIL1
VIH1
tDELAY
tDELAY
1MINIMUM VIH AND MAXIMUM VIL USED. SEE DIGITAL INPUTS
SPECIFICATIONS IN TABLE 3.
Figure 3. Voltage Levels for Timing



Html Pages

1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29


bảng dữ liệu tải về

Go To PDF Page


Link URL



Cho đến nay ALLDATASHEET có giúp ích cho doanh nghiệp của bạn hay không?  [ DONATE ] 

Alldatasheet là   |   Quảng cáo   |   Liên lạc với chúng tôi   |   Chính sách bảo mật   |   Liên kết đến bảng dữ liệu    |   Trao đổi link   |   Tìm kiếm theo nhà sản xuất
All Rights Reserved©Alldatasheet.com


Mirror Sites
English : Alldatasheet.com  |   English : Alldatasheet.net  |   Chinese : Alldatasheetcn.com  |   German : Alldatasheetde.com  |   Japanese : Alldatasheet.jp
Russian : Alldatasheetru.com  |   Korean : Alldatasheet.co.kr  |   Spanish : Alldatasheet.es  |   French : Alldatasheet.fr  |   Italian : Alldatasheetit.com
Portuguese : Alldatasheetpt.com  |   Polish : Alldatasheet.pl  |   Vietnamese : Alldatasheet.vn
Indian : Alldatasheet.in  |   Mexican : Alldatasheet.com.mx  |   British : Alldatasheet.co.uk  |   New Zealand : Alldatasheet.co.nz
Family Site : ic2ic.com  |   icmetro.com