STA380BW datasheet(5/162 Pages) STMICROELECTRONICS

5 / 162 page

DocID024543 Rev 1

5/162

STA380BW

Contents

6.22

Dynamic control registers (addr 0x23 - 0x26 / addr 0x43 - 0x46) . . . . . . 72

6.22.1

Limiter 1 attack/release rate (L1AR addr 0x23) . . . . . . . . . . . . . . . . . . . 72

6.22.2

Limiter 1 attack/release threshold (L1ATRT addr 0x24) . . . . . . . . . . . . 72

6.22.3

Limiter 2 attack/release rate ( L2AR addr 0x25) . . . . . . . . . . . . . . . . . . 72

6.22.4

Limiter 2 attack/release threshold ( L2 ATRT addr 0x26) . . . . . . . . . . . . 72

6.22.5

Limiter 1 extended attack threshold (addr 0x43) . . . . . . . . . . . . . . . . . . 76

6.22.6

Limiter 1 extended release threshold (addr 0x44) . . . . . . . . . . . . . . . . . 76

6.22.7

Limiter 2 extended attack threshold (addr 0x45) . . . . . . . . . . . . . . . . . . 77

6.22.8

Limiter 2 extended release threshold (addr 0x46) . . . . . . . . . . . . . . . . . 77

6.23

User-defined coefficient control registers (addr 0x27 - 0x37) . . . . . . . . . . 77

6.23.1

Coefficient address register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77

6.23.2

Coefficient b1 data register bits 23:16 . . . . . . . . . . . . . . . . . . . . . . . . . . 77

6.23.3

Coefficient b1 data register bits 15:8 . . . . . . . . . . . . . . . . . . . . . . . . . . . 77

6.23.4

Coefficient b1 data register bits 7:0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77

6.23.5

Coefficient b2 data register bits 23:16 . . . . . . . . . . . . . . . . . . . . . . . . . . 78

6.23.6

Coefficient b2 data register bits 15:8 . . . . . . . . . . . . . . . . . . . . . . . . . . . 78

6.23.7

Coefficient b2 data register bits 7:0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78

6.23.8

Coefficient a1 data register bits 23:16 . . . . . . . . . . . . . . . . . . . . . . . . . . 78

6.23.9

Coefficient a1 data register bits 15:8 . . . . . . . . . . . . . . . . . . . . . . . . . . . 78

6.23.10 Coefficient a1 data register bits 7:0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78

6.23.11 Coefficient a2 data register bits 23:16 . . . . . . . . . . . . . . . . . . . . . . . . . . 78

6.23.12 Coefficient a2 data register bits 15:8 . . . . . . . . . . . . . . . . . . . . . . . . . . . 79

6.23.13 Coefficient a2 data register bits 7:0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . 79

6.23.14 Coefficient b0 data register bits 23:16 . . . . . . . . . . . . . . . . . . . . . . . . . . 79

6.23.15 Coefficient b0 data register bits 15:8 . . . . . . . . . . . . . . . . . . . . . . . . . . . 79

6.23.16 Coefficient b0 data register bits 7:0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . 79

6.23.17 Coefficient write/read control register . . . . . . . . . . . . . . . . . . . . . . . . . . 79

6.23.18 User-defined EQ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 82

6.23.19 Pre-scale . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 82

6.23.20 Post-scale . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 82

6.24

Fault-detect recovery constant registers (addr 0x3C - 0x3D) . . . . . . . . . . 84

6.25

Extended configuration register (addr 0x47) . . . . . . . . . . . . . . . . . . . . . . 84

6.25.1

Extended post-scale range . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 84

6.25.2

Extended attack rate . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 84

6.25.3

Extended biquad selector . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 85

6.26

PLL configuration registers (address 0x52; 0x53; 0x54; 0x55;

0x56; 0x57) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 86

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